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인코더 기초: 2-투-1 및 7세그먼트 이진 인코더 설계

인코더란?

인코더는 입력 신호 집합을 이진 코드 출력으로 변환하는 조합 회로입니다. 디코더의 논리적 역. 실제로는 입력 집합을 표현하는 데 필요한 신호 수를 줄여 하류 처리 단순화와 시스템 신뢰성 향상에 쓰입니다.

2-투-1 라인 인코더

개념 설명 위해 1-투-2 디코더 역으로 간단한 2-투-1 라인 인코더 진리표 유도. 디코더 진리표:

D1D0A
010
101

이 관계 역으로 인코더 진리표:

D1D0A
00–
010
101
11–

두 입력이 모두 활성(마지막 행)면 출력은 미정의. 많은 애플리케이션에서 이 상황은 순차 논리 추가해 다중 동시 활성화 감지 및 플래그로 처리해 신뢰성 확보.

인코더 설계 응용

흔한 실전 응용은 이진-7세그먼트 디스플레이 인코더. 일곱 세그먼트(D6~D0) 활성화해 7세그먼트 디스플레이에 10진 숫자 표시. 4비트 이진 입력(I3…I0) 진리표:

I3I2I1I0D6D5D4D3D2D1D0
00001110111
00010010010
00101011101
00111011011
01000111010
01011101011
01101101111
01111010010
10001111111
10011111011

존재하지 않는 10진 숫자(이진 1011 이상)에 해당하는 항목들은 돈-케어 조건으로 처리해 논리 단순화 가능. 카르노 맵 사용해 각 출력 최소 방정식 유도:

인코더 기초: 2-투-1 및 7세그먼트 이진 인코더 설계 인코더 기초: 2-투-1 및 7세그먼트 이진 인코더 설계

결과 단순화 방정식 요약:

인코더 기초: 2-투-1 및 7세그먼트 이진 인코더 설계 인코더 기초: 2-투-1 및 7세그먼트 이진 인코더 설계

결과 회로도

표준 논리 게이트로 방정식 구현하면 다음 회로도:

인코더 기초: 2-투-1 및 7세그먼트 이진 인코더 설계

해당 래더 다이어그램

PLC 응용 위해 래더 로직 등가도 제공:

인코더 기초: 2-투-1 및 7세그먼트 이진 인코더 설계

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