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S-R 래치: 기초, 레이스 컨디션, 실전 응용

바이스테이블 멀티바이브레이터는 두 안정된 상태를 가지므로 접두사 bi. 한 상태는 셋, 다른 상태는 리셋. 이 소자의 가장 기본 형태가 셋-리셋 (S-R) 래치입니다.

S-R 래치 만들려면 두 NOR 게이트를 각 게이트 출력이 다른 게이트 입력으로 피드백되게 배선, 아래와 같은 고전적 크로스 커플 토폴로지 생성:

S-R 래치: 기초, 레이스 컨디션, 실전 응용

출력 Q와 ¬Q는 상호 보완적 기대. S와 R 입력이 모두 높으면 두 출력이 0으로 떨어져 래치의 유효하지 않은 또는 불법 상태. 반면 S=1, R=0이면 래치 '셋'(Q=1, ¬Q=0), S=0, R=1이면 '리셋'(Q=0, ¬Q=1). 두 입력이 모두 0이면 래치 이전 상태 유지.

같은 논리를 래더 로직으로 표현해도 동일 결과:

S-R 래치: 기초, 레이스 컨디션, 실전 응용

정의상 Q=1, ¬Q=0이 셋 조건, Q=0, ¬Q=1이 리셋. 회로 최초 파워온 시 두 게이트나 릴레이 모두 디에너자이즈드 상태라 같은 출력 상태—불안정 상황. 한 구성요소가 다른 것보다 약간 빨리 반응해 장치가 빠르게 셋 또는 리셋으로 해결.

두 요소가 완벽 매칭되면 파워업 시 아스테이블 멀티바이브레이터처럼 진동해 안정된 상태에 결코 안착 못 함. 완벽 매칭 드물지만 짧은 진동 사이클 거의 불가피해 파워업 후 최종 상태 예측 불가. 이 예측 불가함은 두 릴레이(CR1, CR2) 간 레이스 컨디션에서 기인.

레이스 컨디션은 단일 원인으로 두 상호 배타적 이벤트가 동시에 트리거될 때 발생. 이 래치에서 릴레이의 상시 폐쇄 인터록 접점이 양쪽 동시 래치 방지. 두 코일 모두 디에너자이즈드 상태(완전 파워 사이클 후)에서 각 릴레이가 상대 접점 통해 래치 시도, 먼저 에너자이즈된 쪽이 이겨 다른 쪽 강제 오프. 결과는 설계 아닌 부품 공차에 의존해 파워업 후 상태 불확정.

이 레이스 제거 위해 타임딜레이 릴레이 삽입해 한 릴레이에 명확한 이점 부여. 다음 회로도 시연:

S-R 래치: 기초, 레이스 컨디션, 실전 응용

파워업 시 딜레이 접점 TD1 1초간 열려 CR2가 CR1 통해 에너자이즈 방지. CR1이 먼저 전원 받아 에너자이즈, 상시 폐쇄 접점 열어 CR2 래치 불가. 시스템 따라서 예측 가능하게 리셋 상태(S=0, R=0)로 파워업.

레이스 컨디션은 릴레이 회로에만 국한 안 됨; 시퀀싱 세심 관리 안 되면 반도체 논리 설계와 소프트웨어 프로그램에도 나타남. 이런 조건 식별과 완화는 모든 순차 시스템에서 중요.

S-R 래치 흔한 실전 용도는 모터 시작-정지 제어. 간단 래더 로직 구현은 순간 스타트/스톱 푸시버튼을 S, R로 쓰고 컨택터(또는 릴레이)로 모터 에너자이즈. 표준 회로:

S-R 래치: 기초, 레이스 컨디션, 실전 응용

이 설정에서 스타트 버튼 병렬 릴레이 접점은 실-인 접점 역할, 스타트 버튼 놓아도 릴레이 에너자이즈 상태 유지. 스톱 버튼 누르면 릴레이 디에너자이즈, 실 깨지며 모터 정지. 이 단순 래치는 S-R 래치와 동등 기능하며 이중 릴레이 설계의 불안정성 회피.

반도체 형태로 S-R 래치는 개별 집적 회로로 패키징, 아래 표준 심볼로 식별:

S-R 래치: 기초, 레이스 컨디션, 실전 응용

핵심 요약

산업기술

  1. NOR 게이트 SR 래치: 디지털 메모리 구축 및 이해
  2. 인에이블드 NAND 게이트 SR 래치 제작: 부품, 설계, 동작
  3. 게이티드 S-R 래치: 인에이블 입력으로 논리 제어 강화
  4. PCB 제조 마스터하기: 고품질 인쇄회로기판을 위한 핵심 원칙
  5. 인쇄 회로 기판의 진화: 초기 시작부터 현대 기술까지
  6. PCB 테스트 포인트 활용으로 테스트 효율성 및 생산성 향상
  7. 회로 트레이스(PCB 트레이스) 마스터하기: PCB 설계 결정판 가이드
  8. PCB 어셈블리 마스터: 블루프린트에서 완제품까지
  9. PCB 조립 이해: 핵심 기술과 이점
  10. 인쇄 회로 기판의 진화: 기초에서 현대 기술까지