서브파장 금 격자와 공진 공동을 결합한 실리콘 기반 포토디텍터로 근적외선(NIR) 편광 검출 구현. 금-실리콘 쇼트키 계면이 표면 플라즈몬 공명 생성 핫전자 수확, 실리콘 검출 범위 밴드갭 넘어 확장. 유한차분시간영역(FDTD) 시뮬레이션 소자 설계 안내, 전자빔 리소그래피 정밀 나노제작 가능케 함. 실험 결과 -2V 바이어스 하 860nm에서 0.386 A W⁻¹ 책임도 피크, 편광 피크-밸리 비 8.3 달성, 저비용 고성능 NIR 센싱 위한 전실리콘 포토닉스 잠재력 입증.
광통신 급속 발전으로 NIR 작동 저비용 편광 포토디텍터(PD) 수요 증가. 기존 III-V, II-VI 화합물(GaAs/InGaAs, TeCdHg) 높은 흡수 계수이나 고가 성장 공정, 제한적 CMOS 호환성 단점. 반도체 산업 근간 실리콘은 성숙 공정, CMOS 호환성, 실리콘 포토닉스 최근 발전으로 광전자 플랫폼 부상. 실리콘 나노와이어 검출기 포토닉 구조 통합으로 편광 검출 등 새 기능 탐구 시작.
실리콘 나노와이어 PD 선행 연구 기반, 본 논문은 서브파장 금속 격자 임베드 전실리콘 검출기 제시, 동시 편광자 및 공진 공동 역할. 세 설계 과제: (1) 실리콘 나노와이어 감도 NIR 확장, (2) 콤팩트 편광자 통합, (3) 광 수확 구조로 책임도 향상. 제안 아키텍처: 서브파장 금 격자, 제어된 높이 실리콘 나노와이어 어레이, 쇼트키 계면에서 핫전자 생성 및 내부 광방출(IPE) 촉진 플라즈모닉 공진기 결합, 광대역 편광 민감 NIR 검출 가능케 함.
그림 1a 소자 지오메트리 도시. 실리콘 나노와이어 어레이 경도 n-형 실리콘(500µm 두께, 1-10 Ω cm) 상 400nm 피치, 높이(H) 100-300nm 범위 표준 건식 식각 공정 제작. 쇼트키 장벽 금-실리콘 계면 형성. 그림 1b 나노와이어 어레이 위아래 금 층 구성 표면 플라즈모닉 공진기 도시.
그림 1c, 1d 바이어스 조건별 Si-Au 계면 밴드 밴딩 묘사. 밴드갭 초과 광자 에너지(hν > E_g) 정상적 전자-정공쌍 생성, 가시광만 흡수. 그러나 금 층 내부 광방출 효과(IPE) 생성 핫전자 쇼트키 장벽 통과 가능, NIR 검출 가능케 함. 나노와이어 상부 서브파장 금 격자 편광자 기능 겸해 지오메트릭 파라미터로 공진 파장 튜닝.
고효율 NIR 편광 검출 최적화 위해 Lumerical 3D FDTD 시뮬레이션 수행. x, y 방향 주기적 경계 조건, z 방향 완벽 매칭 층. z 방향 전파 TM 편광 평면파 여기 소스. 금 격자 두께 85nm, 폭 200nm, 피치 400nm 설정. 실리콘 기판 상하 반사/투과 모니터로 A = 1-R-T 흡수 스펙트럼 산출.
전자빔 리소그래피로 제작. 300nm PMMA 스핀 코팅 180°C 12분 베이킹. JEOL 6300FS 노광 후 MIBK/IPA(1:3) 23°C 60초 현상. 네이티브 산화막 2% 완충 HF 제거, 2nm Cr/70nm Au 열증착. 60°C 아세톤 리프트오프 패터닝 완료. 금 격자 이후 불소 기반 플라즈마 반응성 이온 식각(RIE)으로 실리콘 식각, 나노와이어 어레이 형성. 최종 15nm Au 박막 전체 소자 증착 공진 공동 생성.
전기 측정 0.7-1.1µm 파장 범위 교정 광원(OPM 35S) 사용. 조명/암조건 전류-전압(I-V) 특성 기록.
그림 2a-d 네 소자 변형 단면 지오메트리: (1) 본딩 패드 평면 Si, (2) 평면 Si Au 격자, (3) Si 나노와이어 위 Au 격자, (4) 완전 공진 공동 검출기. 시뮬레이션 투과, 반사, 흡수 스펙트럼 그림 2e-g. 210nm 높이 나노와이어 어레이에서 860nm 흡수 피크, 상하 금 층 사이 파브리-페로 공진 기인 ~300nm FWHM. 그림 2h(iii) 금속 층 사이 높은 전기장 강도, 효율적 플라즈몬-핫전자 변환 지시.
편광 분석(그림 3a) 860nm 피크 흡수, 흡수-편광각 주기적 변동 피크-밸리 비 ~17:1 산출. 격자 프로파일 추가 최적화로 비율 향상 가능.
SEM 마이크로그래프(그림 4) 각 구조 제작 충실도 확인, 공진 검출기 예상 이중 금 공동 및 나노와이어 어레이 표시.
전기 측정(그림 5a) 공진 검출기(Str.4) -2V 음 바이어스 하 타 구조 대비 10배 높은 광전류 보임. 암전류 ~27nA 낮음, 나노와이어 저항 증가, 15nm Au/Si 계면 공핍층 때문.
열전자 방출 모델 암 I-V 분석으로 쇼트키 장벽 높이 Φ_B ≈ 0.57eV, 이상도 인자 n ≈ 1.43 산출, 열전자 방출 지배적 수송 메커니즘 확인. 책임도 0.386 A W⁻¹ 피크, 150nm FWHM 시뮬레이션 흡수 프로파일 일치. 책임도 스펙트럼 로렌츠 피팅 Φ_B ≈ 0.58eV 산출, IPE 검출 메커니즘 추가 검증.
다양한 조도(그림 6b) 검출기 광전류 선형 스케일링(I_ph = A P^θ, θ ≈ 1), 광전류가 생성 캐리어 수 지배 확인. 책임도 -2V 0.386 A W⁻¹, 0V 0.146 A W⁻¹ 도달.
편광 감도(그림 7) 평면 Au 격자, Au 격자-나노와이어, 공진 검출기 피크-밸리 비 각각 5.6, 6.4, 8.3로 공진 구조 편광 능력 향상 입증. 편광각 빠른 광전류 변조 추가로 편광 감지 적합성 확인.
서브파장 금 격자, 실리콘 나노와이어 어레이, 이중 금 공진 공동 통합 완전 실리콘 기반 포토디텍터로 NIR 편광 검출 구현 입증. 소자 -2V 바이어스 860nm 0.386 A W⁻¹ 피크 책임도, 편광 피크-밸리 비 8.3 달성, 기존 실리콘 PD 대비 NIR 영역 우월. FDTD 시뮬레이션 구조 파라미터로 검출 파장 튜닝 가능 확인, 미래 응용 유연성 제공. 격자 지오메트리 추가 최적화, 상부 금 두께 감소로 책임도, 편광 대비 개선 기대, 비용 효율적 고성능 전실리콘 NIR 센서 길 열음.
나노물질
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